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上文讲解了IR-Drop的原理及现象,本文主要讲芯片Power功耗分析的几种方法。Power and IR-Drop Analysis的所需文件:

Cadence Voltus-功耗分析&IR-drop(四)-cadence如何看pin数

静态功耗分析

vector-driven based

输入门级仿真VCD文件,虽然后仿full VCD文件很大,但静态功耗分析可以读取完整VCD并计算Average Activity。

Cadence Voltus-功耗分析&IR-drop(四)-cadence如何看pin数1

Propagation-based 

工具根据switching probability、static state probability计算功耗,因此用户约束的primary input(比如时钟、复位、enable)、sequential output、clock gate的switching activity constraints就尤为重要。

动态功耗分析

vector-driven based

输入门级仿真VCD文件,动态功耗分析会基于VCD分析哪些器件翻转、什么时候翻转,再根据output load、slew以及cell .lib文件的power arc计算出所有instance的power net动态电流分布。

后仿full VCD很大,动态功耗分析只需截取部分高翻转率波形即可。一般动态功耗分析截取5个系统时钟周期波形即可。

Cadence Voltus-功耗分析&IR-drop(四)-cadence如何看pin数2

vectorless

无VCD的动态功耗分析挑战在于不知道哪些器件翻转、何时翻转,工具基于用户约束的primary input、sequential output、clock gate的switching  activity constraints,以及静态时序分析的timing database来生成一个虚拟的worst-case power vector,然后计算出所有instance的power net动态电流分布current waveforms,该current waveforms也将用于dynamic IR-Drop分析。vector-driven based的动态功耗分析方法相比,vectorless动态功耗分析缺点是精度不高,但其运行速度快。

Cadence Voltus-功耗分析&IR-drop(四)-cadence如何看pin数3

dynamic current waveforms(.ptiavg, 供给IR-Drop分析使

Cadence Voltus-功耗分析&IR-drop(四)-cadence如何看pin数4

转载:全栈芯片工程师

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